Extra cache in the interconnection network.
Not in SPR.
liyichao97 发表于 2022-11-14 09:23
这每核5m还是很不容易的,毕竟是全核共享的l3
等等…2024q1?? 走好不送… ...
埃律西昂 发表于 2022-11-14 18:49
Turin-X最早也是25H1,EMR对手是Genoa-X。所以说虽慢但够?
埃律西昂 发表于 2022-11-14 18:49
Turin-X最早也是25H1,EMR对手是Genoa-X。所以说虽慢但够?
kozaya 发表于 2022-11-14 08:40
终于要开始用3D快取 ? (虽然实际上只有2.7倍)
不过64核心 * 5MB = 320 MB三级缓存
效能提升很大
LV3的萝莉控 发表于 2022-11-14 19:19
每核5M又不算特别大,根本没法和3D$比啊,倒不如说Sapphire Rapids的L3$也太抠门了 ...
kozaya 发表于 2022-11-14 08:40
终于要开始用3D快取 ? (虽然实际上只有2.7倍)
不过64核心 * 5MB = 320 MB三级缓存
效能提升很大
赫敏 发表于 2022-11-15 02:03
牙膏是着了魔?各种互联,封装,缓存,ASIC轮番上阵
Neo_Granzon 发表于 2022-11-15 14:19
很正常,现在提升单核性能的边际收益太低了,必须想办法在核心外做文章。 ...
人撞猪上 发表于 2022-11-15 08:46
据说Arrow Lake 有30%的IPC提升,zen 5就别想了, 估计zen 6都不一定干的过
melancholy05 发表于 2022-11-15 14:25
也不能说单核收益低,只是达到某个程度之后就需要更大的cache来匹配充分发挥算力,这就很需要制造工艺和 ...
Neo_Granzon 发表于 2022-11-15 15:09
现在这种3D cache的尺寸在过去简直是不敢想像的,从面积效能来看收益也很有限,但这已经是提升单核性能最 ...
人撞猪上 发表于 2022-11-15 08:46
据说Arrow Lake 有30%的IPC提升,zen 5就别想了, 估计zen 6都不一定干的过
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