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[CPU] AMD靠着多die实现了超多核心,为什么Intel还迟迟不全面应用?

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发表于 2023-10-22 15:07 来自手机 | 显示全部楼层 |阅读模式
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发表于 2023-10-22 15:16 | 显示全部楼层
不知道牙膏厂在顾虑什么,都已经完全打不过了啊,直接暴力堆就完了,哪怕像一代epyc那样呢,跑分起码能拉起来。。。
发表于 2023-10-22 15:18 来自手机 | 显示全部楼层
AMD这种没有Fab厂的卑鄙无耻小作坊的胶水小把戏我堂堂intel看不上罢了
时间会告诉大家:邪不压正!
发表于 2023-10-22 15:20 | 显示全部楼层
本帖最后由 PolyMorph 于 2023-10-22 15:22 编辑

Intel4马上跟台积电多tile封装了,这么急干啥
14900k买了吗?
发表于 2023-10-22 15:25 | 显示全部楼层
和AMD一样那肯定是不行的,一定要更高端,上3D互联。
发表于 2023-10-22 15:28 | 显示全部楼层
amd的8核cpu那么小一片,上面一半面积还是缓存。intel的13代,你看到的完整芯片,一半面积都是cpu核心,想堆核也堆不出来啊。
发表于 2023-10-22 15:28 | 显示全部楼层
因为制程工艺在晶体管密度跟功耗上落后台积电很多....唯一的优点只有主频能拱得比较高点但这在工作用多核U上屁用没有
发表于 2023-10-22 15:28 | 显示全部楼层
请开始你的表演
发表于 2023-10-22 15:33 | 显示全部楼层
胶水也是有门槛的,大小核设计还是为了可以沿用环形总线
发表于 2023-10-22 15:34 来自手机 | 显示全部楼层
牙膏一个大核面积等于两个zen4,三个zen4c,堆核?拿什么堆
发表于 2023-10-22 15:36 | 显示全部楼层
其实真把W-3400的14核模块拿过来用于桌面,单线程多线程也都打不过自家的8+16吧。
发表于 2023-10-22 17:01 | 显示全部楼层
Intel 的大核是为了保住单线程优势,但是能耗比和核心面积上也牺牲了很多。关键是带来的 ipc 感觉并没有给 zen4 带来致命暴击呀。
发表于 2023-10-22 17:03 | 显示全部楼层
10NM+++的瓶颈了啊。

不是英特尔不想做,是工艺限制死了。

类似AMD双CCD的8P+8P的话,默频满载得400W~
发表于 2023-10-22 23:45 | 显示全部楼层
那么大的die怎么堆?真堆出来不得脸盆那么大面积了。
发表于 2023-10-23 00:41 来自手机 | 显示全部楼层
netlzh 发表于 2023-10-22 17:01
Intel 的大核是为了保住单线程优势,但是能耗比和核心面积上也牺牲了很多。关键是带来的 ipc 感觉并没有给  ...

销量已经是致命暴击了,截止目前的JD销量榜,前20名没有一款7000系CPU,21th是7500f,22th是7800x3d,你就说暴击了没吧
发表于 2023-10-23 08:08 | 显示全部楼层
AMD用一半intel大核面积做到了80%-90%的ipc 这样算效率还真的挺高的
发表于 2023-10-23 08:23 | 显示全部楼层
在做了在做了.jpg
发表于 2023-10-23 10:19 | 显示全部楼层
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发表于 2023-10-23 11:50 来自手机 | 显示全部楼层
wasili8888 发表于 2023-10-23 08:08
AMD用一半intel大核面积做到了80%-90%的ipc 这样算效率还真的挺高的

intel在ipc方面领先没有这么多,不然intel也不会这么难受了
发表于 2023-10-23 12:00 | 显示全部楼层
构架问题,intel那构架堆不了那么多核
发表于 2023-10-23 12:11 | 显示全部楼层
卡卡鸡 发表于 2023-10-23 12:00
构架问题,intel那构架堆不了那么多核

10年前E5V2就有20多核了吧。
发表于 2023-10-23 12:13 | 显示全部楼层
环形总线核心数量上限就那样,跟什么制程啊啥的都没关系,所以现在P+E
发表于 2023-10-23 12:15 | 显示全部楼层
caoyuxin 发表于 2023-10-23 12:11
10年前E5V2就有20多核了吧。

之前是多个ring拼在一起 效率很低,还不如现在的mesh。
发表于 2023-10-23 12:30 | 显示全部楼层
多die和大小核都是没用的技术,消费级只需要超高单核性能。根本用不到那么多核。事实上INTEL单核性能再度领先后7000系销量就惨淡了。我的13600KF一直关小核用。

数据中心市场intel确实难受
发表于 2023-10-23 12:47 | 显示全部楼层
本帖最后由 赫敏 于 2023-10-22 23:53 编辑

我发现楼主的脑回路就是看到一个东西就问别家为什么不去抄。A的缺点也很明显就是同ccd是环形交换速度很快,跨ccd要经过串口上行->IOD环形总线->串口下行->ccd环形总线。你是想牙膏连着缺点一起抄过去?
发表于 2023-10-23 12:50 | 显示全部楼层
caoyuxin 发表于 2023-10-22 23:11
10年前E5V2就有20多核了吧。

以前那个是环形套环形,有些核心之间交换数据过一个环就够了,有些核心之间却要经过两个环甚至3个,效率低且没规律。现在mesh就单纯近的快远的慢规律性强好优化
发表于 2023-10-23 12:57 | 显示全部楼层
卡卡鸡 发表于 2023-10-23 12:00
构架问题,intel那构架堆不了那么多核

d1581:甚至把南桥做了进去
发表于 2023-10-23 13:00 | 显示全部楼层
epyc 7763


xeon 8280


epyc单个路都有3个延迟级别,而牙膏mesh单路都差不多一样
发表于 2023-10-23 13:00 | 显示全部楼层
caoyuxin 发表于 2023-10-23 12:11
10年前E5V2就有20多核了吧。

v2只有ES是15核心
零售最多12C24T
发表于 2023-10-23 13:15 来自手机 | 显示全部楼层
issues 发表于 2023-10-22 15:18
AMD这种没有Fab厂的卑鄙无耻小作坊的胶水小把戏我堂堂intel看不上罢了
时间会告诉大家:邪不压正! ...

Intel的大小核就是一条邪路
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